synopsys,mentor graphic和cadence這三家公司對比?各方面有什麼差別?
公司基本情況
公司業務
EDA公司業務相似,可以分為以下幾塊
1 Total solution。 包括模擬,數字前端、後端、dft、signoff一整套工具。
2 Advanced IP/Library。例如DDR、PCIe、Flash等。
3 Customer support and training.
我們按照EDA工具來進行對比
*模擬模擬與版圖:Cadence Virtuoso平台目前使用最為廣泛。
*數字前端: RTL模擬-- Synopsys的VCS。 Mentor的Modelsim。
綜合--Synopsys Design complier佔主導地位。Cadence也有相應產品Genus。
*數字後端: Synopsys的ICC/ICC2與Cadence的EDI/Innovus業內使用最多。其中上一代工具ICC要比EDI有更多的客戶群,而新一代的Innovus有趕超ICC2的趨勢。Mentor的Olympus,使用客戶很少。
*DFT: BSCAN--Mentor的BSDArchit,Sysnopsy的BSD Compiler
MBIST--Mentor的MBISTArchitect 和 Tessent mbist
ATPG--Mentor的TestKompress 和Synopsys TetraMAX
Scan chain--Synopsys 的DFT compiler
*Signoff: Timing--Synopsys PT佔主導地位。Cadence tempus也有一部分客戶在用。
Physical-- Mentor Calibre佔主導地位。Synopsys的ICV,Cadence的PVS也有佔小部分份額。
總結:
Cadence的優勢在於模擬設計和數字後端。
Synopsys的優勢在於數字前端、數字後端和PT signoff。
Mentor的優勢是Calibre signoff和DFT。
國內員工福利
Cadence國內主要在上海,北京。薪資屬於業界中上,有5%的補充公積金。年假15天,病假12天。每年有兩次左右的team building,還有機會去美國總部培訓。(每年還有5天志願者假,可以去參加公司或者社會上的志願者活動。)
Synopsys應屆生工資比Cadence稍高,有5%的補充公積金。應屆畢業生年假18天,應該是國內IC界年假最多的!
Mentor國內人數較少,不太了解歡迎補充。
公司發展
三家一直在競爭,各自有自己的拳頭產品。
從三家的股價走勢可以看出幾年來Synopsys和Cadence的發展要優於Mentor。(圖片來自新浪財經)
Synopsys
Cadence
Mentor
特別是今年數字後端工具換代,ICC2與Innovus你方唱罷我登場,而M家的Olympus鮮有消息。
在國內S和C很早進入中國布局,在上海、北京招了大量的RD和AE,可以及時的support國內客戶。而M在國內大多數是銷售團隊,而且人數很少。
--------------------------給自己live做個廣告---------------------------
---我們正在進行中的live
從零學習 TCL 腳本 :https://www.zhihu.com/lives/802481845605400576
TCL 腳本:數字 IC 設計應用篇:https://www.zhihu.com/lives/802479838333128704
---我們的專欄
觀芯志:https://zhuanlan.zhihu.com/c_56408722
---往期live
半導體先進工藝的器件結構和挑戰 : https://www.zhihu.com/lives/789127697296019456
你不了解的微電子行業 : https://www.zhihu.com/lives/756215367029772288
初學者在數字 IC 設計學習中易進入的誤區 : https://www.zhihu.com/lives/748851153051066368
三家裡面mentor graphic最老,cadence最年輕。一般認為synopsys的DC綜合和PT時序分析乃是神器,遠強於其餘兩家,市場中占絕大份額。
cadence後端比較強,模擬電路,數模混合以及定製電路這塊比較厲害,PCB上也不錯。
mentor graphic也是在後端布局布線這塊比較強一些,在PCB上也很不錯。當然了,EDA公司提供給IC公司的一般都是全家桶。所以,誰的EDA集成度好其實更有優勢。我們公司用的是cadence全家桶,雖然DC和PT這麼牛逼,我們還是用的cadence的,沒用synopsys的。3家都基本能提供全套的IC design EAD解決方案。Cadence的強項在於模擬或混合信號的定製化電路和版圖設計,功能很強大,特別是Spectre誰用誰知道。但是Sign off的工具偏弱Synopsys最全面,模擬前端的XA,數字前端的VCS, DC和ICC就不用說了,後端的的sign-off tool也很強大,Star-RC/PT/PT-SI, formality等.此外,Candence和Synopsys還提供IP授權(硬核和軟核),這個對於很多中小規模的設計公司是很有吸引力的,打個比方說A公司有一個ASIC項目需要一個時鐘倍頻的模塊,但是因為成本,周期或能力的原因,無法完成一個完整的PLL設計,在基於這兩家的EAD解決方案下,可以給你提供一個完整的PLL,包括一些擴展(可測試性)的電路和版圖設計,外加配套的庫文件。這樣對於A公司來說可以直接把這個IP拿來集成到自己的ASIC里,雖然需要花不少錢,但節省下來的時間和精力還是很寶貴的。授權的IP通常有memory,Serdes和Power management之類的研發成本或門檻相對較高的硬核。Mentor grahic,我只用過前端的Model sim和 questa,感覺GUI做的相較於S家更友好一些。有一個重點是Model sim有面向學生的免費版支持windows,這無疑是對很多在校做VLSI或computer engineer的學生來說是一大福利啊,對我來說真的是,再也不用實驗室跑模擬了...(味太大)外加一點,其實對於公司來講,成本是第一位的,整個設計流程工具之間標準不統一或hand off不能兼容是個很大的問題。所以中小公司比較偏向於買一家公司的工具包。對於一些大公司來說除了成本以外還有一些戰略合作的問題,畢竟雞蛋還是不要放在一個籃子里比較好。而且大公司有專門的Design automation團隊來針對工具和流程做優化,不同公司家的工具之間的兼容也不是太大問題(現在各家的工具特別是前端的通用性都做得挺好)。我司就對S家的一套TOOL做了一套系統的擴展包,無論是在自動化和功能性上,個人感覺已經超越了原生工具。
對於IC設計工程師來說,輔助設計工具再強大也始終是工具,引導和控制工具和設計質量的始終還是工程師自己。在這種情況下,往往工具功能上的擴展性,運行效率和資源佔用多少更重要,想像一下,一個模塊的模擬綜合或PR需要佔用公司一台伺服器70-80個小時的場景吧...這一點,S家的新出的ICC2據說有相當大的提升,效率極高且佔用的硬體資源也少,希望很快能用上
三家都是著名的EDA tool公司,都有自己全套從前端到後端的tool. 基本所有硬體設計公司都會用到三家的tool,每年按照license付錢. 有些公司選用同一個公司的全套tool(全家桶),也有很多公司會同時選用不同家同一功能的tool(尤其前端),方便不同工程師按照個人習慣使用. 除了EDA tool,三家公司都有一個重要的收入來源是知識產權IP. 這也是在目前整個semiconductor行業不是十分景氣情況下,大家比較看好的一個方向(出售IP). 這三家當中Synopsys 的IP賣的最好(應該是在無敵的ARM後面排第二),cadence收購了幾家startup之後應該是排在當中,mentor的IP/VIP目前按我的了解應該排在兩者之後. 如果有誤, 歡迎討論更正, 謝謝.
模擬設計cadence優勢還是挺大的。
我們設計用的就是cadence全家桶,不過也會用一些其他公司的工具輔助。比如很多工程師喜歡用Silvaco的SmartSpice作為模擬器,一些後端檢查工具也是基於SmartSpice的。數字部門好像有不少synopsys的工具。mentor graphic 的工具只用過modelsim,不太了解……學校里也是這樣,模擬課程都是cadence,偶爾用用Hspice;而數字課程就是synopsys的工具居多。我和其他學校的畢業生交流的時候大家都表示學校里都用cadence 做模擬設計,感覺cadence 對學校用戶更熱情一些,這也算是cadence的一大優勢吧……Synopsys 數字最好。而且還有處理器compiler。DC基本是默認的數字標準。
Cadence 以模擬設計見長。Mentor 主要用來Signoff,以及design for manufacturer。甚至是對於foundry那邊光刻之類的是他們的特長。
當年我們部門和Synopsys關係非常好。後來還有spin-off被他們收編,最後鬧掰。現在有3家大多數通用軟體的license,但是現在設計上基本用Cadence的全家桶+mentor的verification+非常少用用Synopsys的PT。三家的產品沒有非此即彼的差距。我廠據說是Cadence為主 —— 我是說數字的部分。
我們公司有個市場活動,每年11月,我一般是track C的主持。track C一般以設計為主題,因此S,C,M三家都有。
我聽了三年,三家聽上去都很屌……但是選用誰家的全家桶,有太多因素,不是什麼強,什麼弱完全決定的。有錢的土豪,還有對比項目。因此,要對比,目的是什麼?買股票?S家買IP,那就case by case的分析EDA工具,也要看,記得你自己團隊的工程師經驗和廠家的技術支持也是非常重要項。
SOC設計中的主要EDA工具
我在Cadence做IP研發,DDR系列產品。我覺得大家說的都很激烈,我簡單補充幾點。1. 硬體加速器,這個東西的溢價是最高的,一個硬體加速器的價格能比幾十套軟體還要貴很多,目前做的做好的是Cadence的帕拉丁系列和Mentor的Veloce系列,Synopsys沒有硬體加速器它有類似的FPGA模擬平台。2. IP,Mentor在IP業務上和Synopsys與Cadence幾乎沒有競爭力,目前S家的IP賣的最好,C家的IP也在逐年銷售額增加。3. Mentor已經被西門子收購了
Synopsys跟別的兩家有一個大家不太了解的區別,S家產品有壟斷市場90%的TCAD器件模擬和壟斷50%的DFM工藝模擬, 這可是在當今各大foundry拼工藝的大環境下的一把profit神器。
公司內部叫SEG(silicon engineering group)有不到一千人, 這裡面大概有一兩百人可以說是physicist(物理學家), 蠻多在歐洲.
國內的九同方還不錯
推薦閱讀:
※想投身數字IC設計方向,碩士階段應該怎麼學習?
※為什麼同族的半導體,原子序數越小禁帶寬度越大?
※pn結正偏時,自由電子是怎樣通過耗盡層的?
※半導體行業不再參照摩爾定律之後將如何發展?
※歐洲微電子中心imec的實力和領域中的聲望如何?和MIT、Intel相比呢?在那裡讀博士前怎麼樣?途?